3． 双端口读写时钟相位相差180 度，以避免双端口读写冲突。
4． 数据的读出、加一和写入采用了流水线结构以提高性能，所以在地址控制上要进行适当暂存以保证数据同步。
图4 为256 级灰度720p 视频图像直方图统计的算法实现功能框图：
图4 用FPGA 的Block RAM 实现直方图统计
结语
该算法借助FPGA 片上的高性能Block RAM（读写速度可以到200 兆以上），可以实现SMPTE 定义的从720p 到1080p 的各种HDTV 视频图像的实时直方图统计，仅占用FPGA不到一百个逻辑单元和一块Block RAM，是一种性价比较高的FPGA 实现直方图统计的算法，而且该算法具有很好的通用性，可以应用到各
种需要大量高位宽计数器的高速FPGA设计中。
参考文献：
1． Xilinx，Spartan-3E FPGA datasheet，2005.3
2． Xilinx，Using Block RAM in Spartan-3 Generation FPGAs，2005.3