引言
采样保持电路(S/H)是数据采集系统尤其是模数转换器(A/D)的一个重要组成部分。近几十年来无线通讯的迅速发展，使得数据的传输速率越来越快。复杂度不断提高的调制系统和电路使得模数转换器(ADC)的采样频率达到射频的数量级，与此同时，模数转换器的精度也超过12位以上。在这种高速度和高精度的要求下，采样保持电路的作用就越发显得重要，因为它可以消除模数转换器前端采样级的大部分动态错误。传统的开环采样保持电路只能达到8～10位的精度，主要由于开关的非理想特性，诸如电荷注入、时钟馈通、开关的非线性电阻等。
另一方面，高精度的闭环采样保持电路又受限于运算放大器的性能。无线通讯系统十分重视降低功耗，流水线A/D通常是无线通讯器件中的一部分，因此在设计的时候也将功耗作为一个重要的考虑因素。本文设计了一个用于14位20MHz流水线A/D的采样保持电路，通过采用flip-around结构来降低功耗。同时为了抑制传统开关的一些非理想特性，采取自举开关来降低信号失真，从而提高整个系统的信噪比。通过采用增益增强技术，实现了高增益低功耗运算放大器。通过这些措施，在较低功耗的情况下仍然获得了 14位的精度。
本文主要分以下几部分：介绍采样保持电路的结构；详细介绍运算放大器的设计；描述自举开关的实现；最后给出电路的仿真结果和结论。
采样保持电路的结构
采样保持电路的要求主要是在较低功耗的情况下能采样大带宽、高频率输入信号，并且在驱动较大负载的情况下实现尽可能小的失真。闭环转换电容采样保持电路通常有两种结构，如图1和图2所示。
图1 电荷传输结构采样保持电路
图2 Filp-around结构采样保持电路
图1所示的结构称之为电荷传输采样保持电路(charge-transferringS/H)。在采样阶段，将输入信号存储在采样电容CS上，并且在保持阶段，仅将差分电荷转移到反馈电容Cf上。因为共模电荷存储在采样电容CS上，所以这种结构的采样保持电路可以处理共模范围较大的输入信号。
图2所示的结构称之为翻转(flip-around)采样保持电路。在采样阶段，将输入信号存储在采样电容C上，而在保持阶段，将采样电容C翻转到输出端。因此，理想的反馈因子β，第一种结构为0.5，而后一种在忽略输入管的寄生电容情况下为1，后者的反馈因子是前者的两倍。因此在同样的闭环带宽要求下，后者的放大器单位增益带宽(GBW)只需要前者的一半，这就大大地降低了放大器的功耗。而采样保持电路的功耗主要来自于内部运算放大器的功耗。
对于A/D而言，采样保持电路的输入噪声直接影响到A/D的输入参考噪声。因此要尽量减小由采样保持电路引入的噪声。在采样阶段，忽略晶体管的寄生电容，则电荷传输采样保持电路的输入参考噪声功率为V2n=(2κT)/C。而翻转采样保持电路的输入参考噪声功率为V2n=κT/C。后者的噪声比前者降低了一半。在保持阶段，假设放大器的噪声主要由输入晶体管的热噪声决定，则输入参考噪声功率可以用公式表示：
V2n=(8πκT)P3βCL[1] (1)
(1)式表明翻转采样保持电路由于较高的反馈因子使得噪声功率仅为电荷传输采样保持电路的1/2。
由于在减小噪声和降低功耗方面的优势，采用翻转结构作为采样保持电路结构。但需要指出的是，由于输入晶体管寄生电容的影响，使得反馈因子小于理想值1，所以在噪声和功率方面的改进可能会小于上面的理想值。另外，如果输入信号的共模电压V sig-cm不等于采样保持电路中运算放大器的输出共模电压V out-cm，则在维持阶段，由于运算放大器的共模反馈电路使得输出的共模电压稳定在V out-cm，因此运算放大器的输入共模电压会有一个阶跃变化ΔV in-cm=V out-cm-V sig-cm。因此为了满足各种共模信号的要求，则该运算放大器要求较大的输入共模范围。
运算放大器的设计
由于噪声和功率方面的优势，采用翻转结构作为采样保持电路的结构，同时采用折叠式共源共栅放大器来实现大输入共模范围的要求。采用PMOS管作为输入管，这样就可以使第二个极点推到较高的位置。因为，第二个极点的位置为折叠点。而NMOS折叠管的寄生电容比PMOS折叠管的寄生电容小的多。除此之外，PMOS管还可以采用自衬底工艺，从而大大减小由于工艺产生的偏差。唯一的缺点是PMOS输入管有较大的寄生电容，从而减小翻转结构在功率和噪声方面的改进。