Synplify Premier FPGA综合工具
Synplify Premier & Synplify Premier withDP软件的推出，进一步巩固了Synplicity在FPGA综合领域的地位。Premier不仅继承了Synplify Pro的全部功能，更加入了众多强大的FPGA综合选项，可以轻松应对复杂的高端FPGA设计和单芯片ASIC 原型验证。
物理综合方面，Premier已经为全球范围内几十家客户成功解决了时序逼近的问题。
Synplicity创新的Graph-based的物理综合方法可以为 FPGA 布线使用的走线、开关和布局点创建详细的布线资源图形。有了这样的图形，优化和布局就能围绕线延时和实际可用的资源而不仅仅是距离来展开。布局、布线和优化将在一个步骤中同时完成，如此一来，反复的综合过程都能在工具内部自行完成，从而达到真正的时序收敛。
另外，Synplify Premier整合了一些特有的功能，方便用户使用单颗FPGA进行ASIC原型验证设计。这些特有的功能包括：全面兼容ASIC代码；支持Gated Clock的转换；支持Design W
are的转换。同时，因为Premier整合了在线调试工具Identify，极大的方便了用户进行软硬件协同仿真，确保设计一次成功，从而大大缩短了整个软硬件开发和调试的周期，并能提供更快的timing-closure和提升整体时序表现。